当 ldaxr 失效时：AArch64 上的独占访问与可缓存性

📌 One-Sentence Summary

深入排查在 AArch64 自旋锁中使用 ldaxr 在 QEMU 中运行正常、却在树莓派 5 上触发数据中止异常（Data Abort）的原因，揭示 Cortex-A76 的全局独占监视器必须依赖通过 SCTLR.C 开启缓存以及配置 Write-Back 内存属性。

📝 Summary

在开发名为 floss 的自定义 AArch64 操作系统内核时，作者发现自定义自旋锁中的 ldaxr 指令在 QEMU 中能够正常执行，但在真实的树莓派 5（Cortex-A76）硬件上却触发了数据中止异常（Data Abort）。通过深入剖析 Arm 内存类型、共享域以及系统寄存器，作者发现 Cortex-A76 CPU 是通过缓存一致性逻辑来实现全局独占监视器的。因此，针对可共享区域的独占内存访问，必须同时在全局层面开启数据缓存（将 SCTLR.C 置为 1）并在页表描述符中配置 Write-Back 属性；一旦回退为不可缓存（Non-cacheable）内存，就会触发异常中止。该问题在 QEMU 中未能显现，是因为该模拟器完全没有对可缓存性语义进行建模。

💡 Main Points

在未开启可缓存性时，ldaxr 指令会在 Cortex-A76 上触发数据中止异常

即使页表项配置了带有 Write-Back 属性的普通内存（Normal memory），如果 SCTLR.C 寄存器的默认值为 0，也会强制将所有数据访问视作不可缓存和非一致性的，从而导致独占加载指令执行失败。

Cortex-A76 严格要求 Write-Back 内存属性才能将内存视为可缓存

实验测试表明，在 Cortex-A76 CPU 上，配置为 Write-Through 的内存会被降级为不可缓存（Non-cacheable），并在独占访问时引发异常，这证明 Write-Back 是执行独占操作的刚性要求。

全局独占监视器依赖硬件缓存一致性逻辑

在类似 Cortex-A76 的现代 Arm 处理器实现中，用于可共享访问的全局独占监视器与缓存一致性机制深度绑定，这意味着一旦停用可缓存性，独占访问便会失败。

类似 QEMU 的模拟器无法替代针对架构边缘情况的真实硬件验证

QEMU 之所以能顺利运行该代码，是因为它完全没有对可缓存性进行建模，并且忽略了 SCTLR.C 标志位，从而掩盖了在物理芯片上才会暴露的硬件级错误。

💬 Key Quotes

在真实硬件上测试让人收获颇丰，也让项目充满了乐趣。然而，正如我们在本文中所详细讨论的那样，真实硬件会暴露出 QEMU 不一定会显现的新维度的潜在故障与行为。

由此看来，只有在同时满足全局启用缓存（SCTLR.C 设为 1）以及页表项具备 Write-Back 属性的前提下，独占加载操作才能在不触发异常的情况下顺利完成。

然而，在深入翻阅 QEMU 源码后发现，它根本就没有对可缓存性进行任何建模（参见提交 fa2ef212df、b0fe242751），SCTLR_C 的常量在任何地方都未被引用也进一步印证了这一点。

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Source： Hacker News

Author： Hacker News

Category： 软件编程

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编程与工程 , 系统设计 , 性能优化 , 树莓派 , AArch64